Schaltungs-Engineering auf Systemebene

Design Gateway ermöglicht die Entwicklung eines Schaltungsentwurfs auf Systemebene, wobei für jedes einzelne Board ein Block- oder Steckersymbol erstellt und verbunden wird, um ein komplettes System zu definieren. Auf diese Weise entfällt die aufwändige Pflege von Spreadsheets für die Dokumentation der Systemverbindungen.

Mit der Multi-Board-Designtechnologie von Design Gateway haben Sie die Möglichkeit, jedes Boardsymbol auszuwählen und eine Netzliste für jede Leiterplatte zu erstellen oder eine vollständige Netzliste auf Systemebene zu erstellen, um die vollständige Analyse eines Platinenlayouts zu unterstützen.

Unabhängig davon, ob Sie mit den komplexen Anforderungen von DDR3/4/5 oder mit der Integration der neuesten Hochgeschwindigkeitsschnittstellen konfrontiert sind – der Constraint Browser von Design Gateway ermöglicht es Ihnen, Beschränkungen für jede Kombination von Netzen, erweiterten Netzen, differentiellen Paaren und Bussen mithilfe von Tabellen zu definieren. Gleichzeitig kann ein Entwickler Layoutregeln für Netze hinzufügen und komplexe Abstandsregeln innerhalb von Netzgruppen und zwischen Netzgruppen zuweisen.

Mit eingebetteten Simulations- und Verifikationswerkzeugen und einer flexiblen Einbung von Best-in-Class-Tools reduziert Design Gateway Fehler und verbessert die Zykluszeit, da nur ein einziger Schaltplan für Platinenlayout und Simulation verwendet wird. Ob Sie nun analoge oder digitale Simulationen benötigen, ob Sie sicherstellen möchten, dass polarisierte Kondensatoren korrekt angeschlossen sind, oder ob Sie sicherstellen möchten, dass die simulierte Signalspannung die Nennleistungen eines Bauteils nicht überschreitet, mit Design Gateway können Sie dies alles in einem Co-Design-Flow realisieren.

Die Vorteile der Wiederverwendung von Designs sind bekannt, aber die Implementierung einer Methodik, die flexibel, einfach zu bedienen und in der Lage ist, ein strukturiertes Datenmanagement zu nutzen, wurde erst mit Design Gateway vollständig realisiert. Die Software für den Schaltungsentwurf bietet einen flexiblen Ansatz. Sie haben die Möglichkeit, mit zertifizierten Schaltungsbausteinen zu arbeiten, bestehende Design als Vorlage für ein neues Design zu verwenden oder zu einem Multi PCB Design zu kombinieren – wahlweise mit einem Top-Down oder Bottom-Up Ansatz. Schaltungsblöcke können in einer Bibliothek gespeichert werden, in der sie katalogisiert, gesucht und ausgewählt werden können. Die Revisionskontrolle ermöglicht die Steuerung aller Änderungen an einem Schaltungsentwurf. All das ist Teil des robusten Ansatzes von Design Gateway für das Arbeiten mit vordefinierten Schaltungsblöcken.

Ein Simulations-Cockpit für Spice-Simulationswerkzeuge (PSpice, LTSpice, HSPICE).

Circuit DR-Navi hilft Design-Teams, technisches Know-how und Best Practices in einer zentralen Wissensdatenbank zu konsolidieren, die in den Designprozess integriert ist. Während des Arbeitens am Schlatungsentwurf können Ingenieure auf einen hinterlegte Parameter zugreifen oder projektspezifische Anweisungen erstellen, um die Designrichtlinien über den gesamten PCB Designfluss zu steuern.

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Der Graphical Pin Manager (GPM) bietet eine effektive FPGA/PCB Co-Design-Umgebung, die die neuesten Komponenten von FPGA Anbietern wie Xilinx, Altera, Lattice und Microsemi unterstützt.

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Der Circuit Adviser von Design Gateway ermöglicht die Durchführung gleichzeitiger, komplexer Regelprüfungen bei der Schaltungsentwicklung. Die Regeln und Bedingungen können vom Anwender definiert werden. Prüfergebnisse können analysiert und mit dem Design verglichen werden.

Der Design Gateway Viewer ist ein Viewer mit dem Daten der Schaltungsentwurf Software Design Gateway dargestellt und mit umfassenden Analysefunktionen, wie Cross-Probing, Constraint Viewing, Signalklassen untersucht werden können.

Szenario EX ermöglicht die Prüfung der elektrischen Eigenschaften und der Verbindungstopologie von Signalpfaden. Es unterstützt „What-If-Szenarien“ für Schaltplan- und Layoutdaten, mit denen das Verhalten eines Schaltungsentwurfs optimiert werden kann. Es kann sowohl für begleitend zum interaktiven Arbeiten als auch für die Verifizierung vollständiger Platinenlayouts eingesetzt werden.

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